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Электронный компонент: CY7C1487V33

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PRELIMINARY
CY7C1481V33
CY7C1483V33
CY7C1487V33
Document #: 38-05284 Rev. *A
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Logic Block Diagrams
CY7C1481V33 2M x 36
CY7C1483V33 4M X 18
CLK
ADV
ADSC
A
[20:0]
GW
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BW
d
BW
c
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b
BW
a
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1
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3
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2
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ZZ
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REGISTER
INPUT
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2M
X36
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Q
0
Q
1
Q
D
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36
21
19
19
21
(A
[1;0]
)
2
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DP
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d
, DP
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REGISTERS
D
Q
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c
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D
Q
D
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REGISTERS
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BYTEWRITE
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Q
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REGISTER
D
Q
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REGISTER
D
Q
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ADV
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[21:0]
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b
BW
a
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1
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3
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2
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REGISTER
INPUT
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MEMORY
ARRAY
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Q
0
Q
1
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D
CE
CE
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SLEEP
CONTROL
18
18
22
20
20
22
(A
[1;0]
)
2
MODE
ADSP
DQ
a,b
DP
a,b
DQ
b
, DP
b
BYTEWRITE
REGISTERS
D
Q
DQ
a
, DP
a
BYTEWRITE
REGISTERS
D
Q
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REGISTER
D
Q
ENABLE DELAY
REGISTER
D
Q
CE
4M X 18
PRELIMINARY
CY7C1481V33
CY7C1483V33
CY7C1487V33
Document #: 38-05284 Rev. *A
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.
CY7C1487V33 1M x72
Logic Block Diagrams
(continued)
CLK
ADV
ADSC
A
[19:0]
GW
BWE
BW
h
BW
g
BW
f
BW
e
CE
1
CE
3
CE
2
OE
ZZ
BURST
COUNTER
ADDRESS
REGISTER
INPUT
REGISTERS
1M
X72
MEMORY
ARRAY
CLK
Q
0
Q
1
Q
D
CE
CE
CLR
SLEEP
CONTROL
72
72
20
18
18
20
(A
[1;0]
)
2
MODE
ADSP
DQ
a,b,c,d,e,f,g,h
DP
a,b,c,d,e,f,g,h
DQ
h
, DP
h
BYTEWRITE
REGISTERS
D
Q
DQ
g
, DP
g
BYTEWRITE
REGISTERS
D
Q
D
Q
DQ
f
, DP
f
BYTEWRITE
REGISTERS
DQ
e
, DP
e
BYTEWRITE
REGISTERS
D
Q
ENABLE CE
REGISTER
D
Q
ENABLE DELAY
REGISTER
D
Q
BW
d
BW
c
BW
b
BW
a
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c
, DP
c
BYTEWRITE
REGISTERS
D
Q
D
Q
DQ
b
, DP
b
BYTEWRITE
REGISTERS
DQ
a
, DP
a
BYTEWRITE
REGISTERS
D
Q
DQ
d
, DP
d
BYTEWRITE
REGISTERS
D
Q
Selection Guide
CY7C1481V33-150
CY7C1483V33-150
CY7C1487V33-150
CY7C1481V33-133
CY7C1483V33-133
CY7C1487V33-133
CY7C1481V33-117
CY7C1483V33-117
CY7C1487V33-117
CY7C1481V33-100
CY7C1483V33-100
CY7C1487V33-100
Unit
Maximum Access Time
5.5
6.5
7.5
8.5
ns
Maximum Operating Current
TBD
TBD
TBD
TBD
mA
Maximum CMOS Standby
Current
TBD
TBD
TBD
TBD
mA
PRELIMINARY
CY7C1481V33
CY7C1483V33
CY7C1487V33
Document #: 38-05284 Rev. *A
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Pin Configurations
A
A
A
A
A
1
A
0
A
V
SS
V
DD
A
A
A
A
A
A
A
A
A
NC
NC
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DDQ
V
SSQ
NC
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DQa
DQa
V
SSQ
V
DDQ
DQa
DQa
V
SS
NC
V
DD
ZZ
DQa
DQa
V
DDQ
V
SSQ
DQa
DQa
NC
NC
V
SSQ
V
DDQ
NC
NC
NC
NC
NC
NC
V
DDQ
V
SSQ
NC
NC
DQb
DQb
V
SSQ
V
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DQb
DQb
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DD
NC
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SS
DQb
DQb
V
DDQ
V
SSQ
DQb
DQb
DPb
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V
SSQ
V
DDQ
NC
NC
NC
A
A
CE
1
CE
2
NC
NC
BW
b
BW
a
CE
3
V
DD
V
SS
CL
K
GW
BW
E
OE
AD
SC
AD
SP
AD
V
A
A
1
2
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5
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80
79
78
77
76
75
74
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72
71
70
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68
67
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60
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58
57
56
55
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100
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98
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96
95
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91
90
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88
87
86
85
84
83
82
81
MOD
E
CY7C1483V33
(4M x 18)
NC
A
A
A
A
A
1
A
0
A
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SS
V
DD
A
A
A
A
A
A
A
A
A
DQPb
DQb
DQb
V
DDQ
V
SSQ
DQb
DQb
DQb
DQb
V
SSQ
V
DDQ
DQb
DQb
V
SS
NC
V
DD
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DQa
DQa
V
DDQ
V
SSQ
DQa
DQa
DQa
DQa
V
SSQ
V
DDQ
DQa
DQa
DQPa
DQPc
DQc
DQc
V
DDQ
V
SSQ
DQc
DQc
DQc
DQc
V
SSQ
V
DDQ
DQc
DQc
V
DD
NC
V
SS
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DQd
V
DDQ
V
SSQ
DQd
DQd
DQd
DQd
V
SSQ
V
DDQ
DQd
DQd
DQPd
A
A
CE
1
CE
2
BW
d
BW
c
BW
b
BW
a
CE
3
V
DD
V
SS
CL
K
GW
BW
E
OE
AD
SC
AD
SP
AD
V
A
A
1
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38
39
40
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42
43
44
45
46
47
48
49
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80
79
78
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75
74
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72
71
70
69
68
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65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
10
0
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
MO
DE
CY7C1481V33
(2M X 36)
NC
A
100-pin TQFP
(Top View)
A
A
PRELIMINARY
CY7C1481V33
CY7C1483V33
CY7C1487V33
Document #: 38-05284 Rev. *A
Page 5 of 30
Pin Configurations
(continued)
2
3
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7
1
A
B
C
D
E
F
G
H
J
K
L
M
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P
R
T
U
V
DDQ
NC
NC
DQPc
DQc
DQd
DQc
DQd
A
A
A
A
ADSP
V
DDQ
A
DQc
V
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DQc
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NC
NC
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CLK
V
DD
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NC
NC
NC
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TCK
TDI
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A
A
NC
V
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A
A
A
A
A
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A
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A
A
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A0
A1
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DQa
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DQa
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V
DD
DQc
DQc
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V
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DQd
DQd
DQd
DQd
ADSC
NC
CE
1
OE
ADV
GW
V
SS
V
SS
V
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V
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MODE
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b
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NC
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V
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SS
NC
NC
NC
NC
TDO
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TDI
TMS
A
A
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DDQ
V
DDQ
A
A
A
A
A
A
A
A
A
A
A
A0
A1
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NC
NC
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NC
DQa
DQa
NC
NC
DQa
NC
DQa
NC
DQa
NC
DQa
V
DD
NC
DQb
NC
VDD
DQb
NC
DQb
NC
ADSC
NC
CE
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ADV
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SS
V
SS
V
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BW
a
NC
BWE
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ZZ
CY7C1483V33 (4M x 18)
CY7C1481V33 (2M x 36)
A
A